류형록 | Engineering Portfolio · 전체 프로젝트
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디지털·전력·전동기·제어·RF·센서
VHDL 7/7 PASS / 회로도·계산표·파형·설계 보고서
VHDL Controller Logic · 900 W 변압기 설계 · 765 kV 송전선로 분석 · DC 모터 PI 제어 · RF 수동회로 설계 · AESA·SAR 개념설계
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Electrical Engineering Coursework · Case Study Hub
Coursework Website · GitHub Guide · Repository
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flowchart LR
A["Course source"] --> B["Equation · circuit · code"]
B --> C["Calculation · simulation"]
C --> D["Result · error review"]
D --> E["Case study · related project"]
과목별 설계 자료: VHDL·계산표·회로도·파형·보고서. 개념 노트와 당시 과제 자료는 각 페이지의 자료 유형으로 표시.
| Domain | Engineering output | 공부하며 확인한 내용 |
|---|---|---|
| RTL / VHDL | 7 blocks · self-checking testbench · VCD | GHDL 7/7 PASS |
| Electrical Machines | 900 W transformer core trade study | Independent recalculation |
| Power Systems | 765 kV line Zc/SIL + policy review | Calculation + non-convergence boundary |
| Motor Control | Cascaded PI + torque-ripple comparison | Calculation + existing archive |
| RF/Microwave | Microstrip · matching · divider · hybrid | Theory + existing Cadence archive |
| Sensor Systems | AESA-SAR + physics-guided diffusion | 개념 설계 제안 |